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SmartCar-V1
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SmartCar-V1
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xqq27
6eed76dd66
根据安富莱的usart底层,缝合了ir controller的RXNE接收中断来接收数据的逻辑。
2025-05-08 23:18:49 +08:00
..
Output
根据安富莱的usart底层,缝合了ir controller的RXNE接收中断来接收数据的逻辑。
2025-05-08 23:18:49 +08:00
mem_bar.exe
提交写了一点点的蓝牙头文件。。。并提交偶然间发现的小工具,可以直观地看ram和rom。项目地址:
https://gitee.com/MoodDream/keil-memory-bar
2024-12-03 21:55:42 +08:00
script.bat
提交从正点原子mini板的程序移植过来的工程
2024-11-30 10:27:03 +08:00
TianyunV1.uvoptx.bak
led部分的bsp部分完成,接下来开始写驱动部分
2025-04-28 16:45:44 +08:00
TianyunV1.uvprojx
根据安富莱的usart底层,缝合了ir controller的RXNE接收中断来接收数据的逻辑。
2025-05-08 23:18:49 +08:00